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ADCコア

アナログ信号をデジタル信号に変換するコアです。
変換速度とビット数やチャネル数あるいは入力信号の振幅などで種類が分かれています。

ビット MHz(max.) ch数 CB-12 CB-90 CB-55 CB-40
6 95 1/2 ◎ (M: 3.3 V) ↓ (6 bit 100 M)
100 1 ◎ (M,L: 3.3 V)
140 3 ◎ (M: 3.3 V)
8 8 1 ◎ (M: 3.3 V)
30 1 ◎ (M: 3.3 V)
10 0.5 12 ◎ (L: 3.3 V) ◎ (M,L: 3.3 V)
1 8 ◎ (L: 3.3 V) ◎ (M: 3.3 V) ◎ (L, LD, LR, LRD: 3.3 V)
20 1 ◎ (M: 3.3 V)
40 1 ◎ (M: 3.3 V) ◎ (M: 3.3 V)
12 0.2 12 ◎ (L, LD, LR: 3.3 V)

◎:正式リリース中、○:暫定リリース中、△:暫定対応可(要相談)、↓:別のタイプで対応可能

セルベースIC製品シリーズ対応

DACコア

デジタル信号をアナログ信号に変換するコアです。
変換速度とビット数やチャネル数あるいはアナログ出力信号の振幅などで種類が分かれます。

ビット MHz (max.) ch数 CB-12 CB-90 CB-55 CB-40
8 5 2 ◎ (M,L: 3.3 V)
35 1/2/3 ◎ (M: 3.3 V)
10 30 1/2/3 ↓ (10 bit 35 M) ◎1ch
(M,L: 3.3 V)
◎1ch
(L: 3.3 V)
◎1ch
(L, LD: 3.3 V)
35 1/2/3 ◎ (M: 3.3 V)
80 1/2/3 ◎ (M: 3.3 V)
150 1 ◎ (M: 3.3 V)
12 170 2/3 ◎ (L: 3.3 V)

◎:正式リリース中、○:暫定リリース中、△:暫定対応可(要相談)、↓:別のタイプで対応可能

セルベースIC製品シリーズ対応

PLL/VCO/SSCG/DLLコア

PLLはASICのシステムクロック生成などに使用する発振回路の一種です。PLL入力-出力間の位相関係の定義の要/不要により大別されます。EMIレベルを低減するSSCG (Spread Spectrum Clock Generator) や、クロック信号とデータ・バスとのズレを調整するDLLの整備もすすめています。

トピックス

方式 MHz
(min.)
MHz
(max.)
CB-12 CB-90 CB-55 CB-40
Skew Control 200 400 ◎ (M: 1.5 V) ◎ (M: 1.0 V)
650 1340 ◎ (M: 1.0 V)
800 1600 ◎ (L: 1.2 V) ◎ (L: 1.1 V)
1000 2000 ◎ (M: 1.0 V)
1600 3200 ◎ (L: 1.1 V)
Multiplying 25 50
(M: 0.9-1.65 V)
35 70 ◎ (M: 1.5 V)
45 100
(M: 0.9-1.65 V)
70 120 ◎ (M: 1.5 V)
100 200 ◎ (M: 1.5 V)
60 250 ◎ (M: 1.5 V) ◎ (M: 1.0 V)
170 340 ◎ (L: 1.2 V)
200 400 ◎ (M: 1.0 V) ◎ (L: 1.2 V)
250 400 ◎ (M: 1.5 V)
400 800 ◎ (M: 1.0 V)
800 1600 ◎ (L: 1.1 V)
SSCG 48 100 ◎ (M: 1.5 V)
100 200 ◎ (M: 1.5 V)
200 400 ◎ (M: 1.0 V) ◎ (L: 1.2 V)
365 800 ◎ (M: 1.0 V)
400 800 ◎ (M: 1.0 V)
800 1600 ◎ (L: 1.1 V)
Multi Phase Output 400 800 ◎ (M: 1.5 V)
500 1000 ◎ (M: 1.0 V)
DDR Interface 100 175 ◎ (M: 1.5 V)  
100 180 ◎ (M: 1.0 V)
166 400 ◎ (M: 1.0 V)    

◎:正式リリース中、○:暫定リリース中、△:暫定対応可(要相談)、↓:別のタイプで対応可能

セルベースIC製品シリーズ対応

レーザコントロールコア(PWM)

PWMコア(Pulse Width Modulation)を、レーザを用いるビジネスプリンタや複写機に特化して機能と使い勝手を追求し、高精度動作と低消費電力および耐雑音性を両立するオンチップコアです。

CB-12 CB-90
PWM

●:リリース済み

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